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[单选题]
（电子专业作）对于VHDL以下几种说法错误的是_________。
A
VHDL程序中是区分大小写的
B
一个完整的VHDL程序总是由库说明部分、实体和结构体等三部分构成
C
VHDL程序中的实体部分是对元件和外部电路之间的接口进行的描述，可以看成是定义元件的引脚
D
结构体是描述元件内部的结构和逻辑功能
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参考答案
试题答案：
A
答案解释：
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